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課程對(duì)象

FPGA 設(shè)計(jì)者和邏輯設(shè)計(jì)者

課程概要

1

• 7 系列 FPGA 概述
• 收發(fā)器簡(jiǎn)介
• 收發(fā)器時(shí)鐘控制和復(fù)位
• 8B/10B 編碼器和解碼器
• 實(shí)驗(yàn)1：8b/10b 運(yùn)行不一致與旁路
• 逗點(diǎn)和解串器對(duì)齊
• 實(shí)驗(yàn)2：逗點(diǎn)和數(shù)據(jù)對(duì)齊

2

• RX 彈性緩沖器和時(shí)鐘校正
• 實(shí)驗(yàn)3：時(shí)鐘校正
• 通道綁定
• 實(shí)驗(yàn)4：通道綁定
• 收發(fā)器向?qū)Ц攀?/li>
• 實(shí)驗(yàn) 5:?收發(fā)器內(nèi)核生成
• 仿真和實(shí)現(xiàn)一個(gè)收發(fā)器設(shè)計(jì)
• 實(shí)驗(yàn) 6:?收發(fā)器仿真和實(shí)現(xiàn)
• 物理媒體副件（Physical Media Attachment）

3

• 64B/66B 編碼和變速箱
• 實(shí)驗(yàn)7：?64B/66B 編碼
• 收發(fā)器板設(shè)計(jì)的考慮事項(xiàng)
• 收發(fā)器測(cè)試與調(diào)試
• 實(shí)驗(yàn) 8：使用 Xilinx 開發(fā)板進(jìn)行系統(tǒng)實(shí)驗(yàn)或 IBERT 實(shí)驗(yàn)
• 收發(fā)器應(yīng)用實(shí)例