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使用6系列FPGA產(chǎn)品進(jìn)行設(shè)計(jì)培訓(xùn)之
利用 Spartan-6 和 Virtex-6 系列進(jìn)行設(shè)計(jì)培訓(xùn)

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        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會。

課程概要

1

• Spartan-6 FPGA 簡介
• Virtex-6 FPGA 簡介
• CLB 架構(gòu)
• HDL 編碼技術(shù)
• 實(shí)驗(yàn)1：CLB 資源
• 存儲器資源
• DSP 資源

2

• 實(shí)驗(yàn)2：DSP 資源
• 基本 I/O 資源
• Spartan-6 FPGA I/O 資源
• Virtex-6 FPGA I/O 資源
• 實(shí)驗(yàn)3：I/O 資源
• 基本時鐘控制資源

3

• Spartan-6 FPGA 時鐘控制資源
• Virtex-6 FPGA 時鐘控制資源
• 實(shí)驗(yàn)4：時鐘控制資源
• 存儲器控制器
• 專用硬件

?Spartan-6 系列課程概要

1

• Spartan-6 FPGA 簡介
• CLB 架構(gòu)
• HDL 編碼技術(shù)
• 實(shí)驗(yàn)1：CLB 資源
• 存儲器資源
• DSP 資源
• 實(shí)驗(yàn)2：DSP 資源
• 基本 I/O 資源
• Spartan-6 FPGA I/O 資源

2

• 實(shí)驗(yàn)3：I/O 資源
• 基本時鐘控制資源
• Spartan-6 FPGA 時鐘控制資源
• 實(shí)驗(yàn)4：時鐘控制資源
• 存儲器控制器
• 專用硬件

Virtex-6 系列課程概要

1

• Virtex-6 FPGA 簡介
• CLB 架構(gòu)
• HDL 編碼技術(shù)
• 實(shí)驗(yàn)1：CLB 資源
• 存儲器資源
• DSP 資源
• 實(shí)驗(yàn)2：DSP 資源
• 基本 I/O 資源

2

• Virtex-6 FPGA I/O 資源
• 實(shí)驗(yàn)3：I/O 資源
• 基本時鐘控制資源
• Virtex-6 FPGA 時鐘控制資源
• 實(shí)驗(yàn)4：時鐘控制資源
• 存儲器控制器
• 專用硬件