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   上課時間和地點
上課地點：【上�！浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）：FPGA設(shè)計執(zhí)行培訓(xùn)課程：2025年12月15日..以質(zhì)量求發(fā)展....合作共贏....實用實戰(zhàn).....直播、現(xiàn)場培訓(xùn)皆可....用心服務(wù)..........--即將開課--...............................(歡迎您垂詢，視教育質(zhì)量為生命！)
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        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
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課程描述：

第一階段 Advanced FPGA Synthesis using Synplify Pro & Synplify Premier

Overview
This course first introduces new users to the Synplify Pro and Synplify Premier tools. Designers can take this course at their own pace and enjoy the online version of this class. Comprehensive notes complete the information displayed on each page. This course is powered by Vitalect.

Objectives
The course will familiarize new students with the FPGA design flow utilizing features of the Synplify Pro product, enabling them to actively create designs using the Synplify Pro product. The course then expands on these concepts to focus on complex design techniques, debugging and high-performance design, as well as physical synthesis.

Audience Profile
Designers who wish to maximize the performance of their designs, or learn more powerful design techniques using the Synplify Pro and Synplify Premier tools.

Prerequisites
Knowledge of logic synthesis and FPGA technologies.

Course Outline
  • Getting Started
  • Timing Optimizations
  • Design Analysis and Debugging
  • Handling IPs
  • Xilinx Specific Topics
  • Altera Specific Topics
  • Actel Specific Topics
  • Lattice Specific Topics
  • Synplify Premier Physical Synthesis For Xilinx
  • Synplify Premier Design Planner for Xilinx
  • Synplify Premier Physical Synthesis for Altera

第二階段 Advanced FPGA Debugging with the Identify Tool?

Overview
This course introduces concepts on full-speed hardware debugging using the Identify toolset which provides an embedded HDL analyzer with debug access at the RTL level similar to an RTL simulator. Designers can take this course at their own pace and enjoy the online version of this class. Comprehensive notes complete the information displayed on each page. This course is powered by Vitalect.

Objectives
The course focuses on understanding concepts on instrumenting the design and using the Identify product to successfully verify the functionality of hardware.

Course Outline

  • Identify Instrumentor
  • IICE
  • Identify Debugger
  • Advanced Debugging

第三階段 Asic Prototyping with the Certify? Tool?

Overview
This course introduces concepts on ASIC prototyping using the Certify ASIC Prototyping tool. Designers can take this course at their own pace and enjoy the online version of this class. Comprehensive notes complete the information displayed on each page. This course is powered by Vitalect.

Objectives
The focus will be on understanding concepts on RTL-level partitioning, and using the Certify product to create a successfully partitioned design. Students will learn:
  • Certify Product Concepts
  • Understanding the Certify UI
  • Specification of Prototype Board Descriptions
  • Partitioning to FPGA Devices

Course Outline

  • Project Management
  • RTL Prototyping Concepts
  • Defining a Board Description File
  • Quick Partitioning Technology
  • Advanced Partitioning Tools
  • Area Estimation
  • Creating a Successful Partition
  • Hierarchical Systems
  • Debug Insertion Features
  • Performing Pin Assignment
  • MultiPoint? Synthesis Flow

第四階段 Advanced Algorithm Implementation with Synphony Model Compiler

Overview
This course first introduces new users to the Synphony HLS tools. Designers can take this course at their own pace and enjoy the online version of this class. Comprehensive notes complete the information displayed on each page. This course is powered by Vitalect.

Objectives
The course will familiarize new students with the Synphony Model Compiler design flow including model creation, implementation and architectural exploration, enabling them to actively create designs using the Synphony high-level synthesis products. The course then expands on these concepts to focus on more complex modeling and implementation features.

Course Outline

  • Flow Overview
  • Signal Date Types
  • Vector Support
  • Multi-rate Modeling
  • Architectural Synthesis
  • Micro-architectural Optimizations
  • Retiming
  • Folding and Multi-Channelization
  • Advanced Features and IP Functions
 
版權(quán)所有：上海曙海信息網(wǎng)絡(luò)科技有限公司 copyright 2000-2016
 
上�？偛颗嘤�(xùn)基地

地址：上海市云屏路1399號26#新城金郡商務(wù)樓310。
（地鐵11號線白銀路站2號出口旁,云屏路和白銀路交叉口）
郵編：201821
熱線：021-51875830 32300767
傳真：021-32300767
業(yè)務(wù)手機:15921673576
E-mail:officeoffice@126.com
客服QQ: shuhaipeixun

重慶培訓(xùn)基地
地址：重慶市南岸區(qū)南坪西路17號福天大廈4層
熱線：4008699035
郵編：400060

大連培訓(xùn)基地
地址：大連市中山區(qū)中山路136號希望大廈5層
熱線：4008699035
北京培訓(xùn)基地

地址:北京市昌平區(qū)沙河南街11號312室
（地鐵昌平線沙河站B出口） 郵編：102200 行走路線：請點擊這查看！
熱線：010-51292078
傳真：010-51292078
業(yè)務(wù)手機:15701686205
E-mail:qianru@51qianru.cn
客服QQ:1243285887

青島培訓(xùn)基地
地址：島市市南區(qū)延吉路111號青島賽納商務(wù)中心2層
熱線：4008699035

寧波培訓(xùn)基地
地址：寧波市北侖區(qū)靈江路378號侖江大廈7層
熱線：4008699035
深圳培訓(xùn)基地

地址：深圳市環(huán)觀中路28號82#201室
熱線：4008699035
傳真：4008699035
業(yè)務(wù)手機：4008699035

郵編：518001
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客服QQ:2472106501
南京培訓(xùn)基地

地址：江蘇省南京市棲霞區(qū)和燕路251號金港大廈B座2201室
（地鐵一號線邁皋橋站1號出口旁，近南京火車站）
熱線：4008699035
傳真：4008699035
郵編：210046
信箱:qianru3@51qianru.cn
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福州培訓(xùn)基地
地址：福州市晉安區(qū)長樂北路116號立洲大廈2層
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濟南培訓(xùn)基地
地址：濟南市歷城區(qū)華信路2號歷城金融大廈9層
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地址：杭州市上城區(qū)解放路138號航天通信大廈3層
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成都培訓(xùn)基地

地址：四川省成都市高新區(qū)中和大道一段99號領(lǐng)館區(qū)1號1-3-2903 郵編：610031
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地址：湖北省武漢市東湖高新技術(shù)開發(fā)區(qū)高新二路128號 佳源大廈一期A4-1-701 郵編：430022
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地址：廣州市越秀區(qū)環(huán)市東路486號廣糧大廈1202室

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