
曙海教學(xué)優(yōu)勢
該課程,秉承21年教學(xué)品質(zhì),以項目實現(xiàn)為導(dǎo)向,面向企事業(yè)單位項目實際需求,講師將會與您分享設(shè)計的全流程以及工具的綜合使用技巧與經(jīng)驗。課程可定制,線下/線上/上門皆可,全國免費報名熱線:4008699035。
曙海培訓(xùn)的課程培養(yǎng)了大批受企業(yè)歡迎的工程師。大批企業(yè)和曙海
建立了良好的合作關(guān)系,合作企業(yè)三十多萬家。曙海的課程得到業(yè)內(nèi)企事業(yè)單位廣泛贊譽。
課程大綱
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一、FPGA課程概要
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1)FPGA功耗需求;
2)Xilinx功耗評估器(XPE)電子 數(shù)據(jù)表;
3)實驗1:使用XPE 做功耗評估、Xilinx 功耗分析器(XPA);
4)實驗 2:使用XPA 做功耗評估;
5)實驗 3:動態(tài)功耗評估、功耗管理軟件選項;
6)實驗 4:功耗管理軟件選項、功耗管理設(shè)計技術(shù)、I/O 資源的功耗最優(yōu)化、7 系列功耗管理特性、如何解決功耗問題、最壞情況的發(fā)熱計算(可選)、K7 FPGA功耗管理特性。GA功耗最優(yōu)化
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二、時序約束
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1)實驗 1:Vivado IDE 數(shù)據(jù)庫——利用 Vivado IDE 數(shù)據(jù)庫設(shè)置設(shè)計屬性
2)實驗 2:Vivado IDE 時鐘——為設(shè)計時鐘資源創(chuàng)建完整的XDC約束,執(zhí)行設(shè)計并查看時鐘報告以驗證結(jié)果;
3)實驗 3:IO 約束——創(chuàng)建源同步設(shè)計的輸入和輸出時序約束,同時將生成有效的時序報告驗證時序結(jié)果;
4)實驗 4:時序異?!褂脮r序約束窗口輸入時序異常的相關(guān)XDC約束,并通過時序報告驗證時序結(jié)果;
5)實驗 5:高級IO時序——為源同步DDR接口做時序約束,執(zhí)行靜態(tài)時序分析以確定最優(yōu)化時鐘和數(shù)據(jù)的最大設(shè)置和保持時間的盈余量。最后,調(diào)整數(shù)據(jù)延遲實現(xiàn)最優(yōu)化時序;
6)實驗 6:時序收斂和設(shè)計轉(zhuǎn)化——學(xué)習(xí)如何基于 7 系列架構(gòu)最優(yōu)化常規(guī)的處理器設(shè)計 ,通過基本設(shè)計修改來影響專有硬件的使用、設(shè)計速度和器件利用率
1、UltraFast 設(shè)計方法
1)UltraFast設(shè)計方法: 創(chuàng)建設(shè)計
2、設(shè)計技術(shù)
1)同步設(shè)計技術(shù){講座}
2)復(fù)位**
3)寄存器復(fù)制
3、UltraScale結(jié)構(gòu)中的時鐘
1)時鐘資源**
4、Versal ACAP結(jié)構(gòu)中的時鐘
1)Versal ACAP:時鐘結(jié)構(gòu)
5、UltraScale結(jié)構(gòu)中的I/O
1)I/O邏輯資源
6、Versal ACAP結(jié)構(gòu)SelectIO資源
1)SelectIO資源
2)Versal ACAP中時鐘和I/O資源**
7、IP集成器
1)生成和封裝定制化 IP ** ?
2)使用 IP Container* ?
3)使用 IP 集成器進行設(shè)計***(案例研究)
8、時序—interdediate
1)時序約束編輯器
2)時鐘網(wǎng)絡(luò)報告* ?
3)時序摘要報告* ?
4)時鐘組約束* ?
5)介紹時序例外***
無*項為講座, *項為講座和演示,**項為講座和實驗,***項為講座、演示和實驗